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LTE 20M 接收时序控制

lu_mail 在 2015-12-10 詢問的問題

当前配置 LTE 20M 2R2T DDR  FDD MGC,加载AD936x 评估软件相应模式的配置后,在FPGA 端采集信号(芯片灌入一个偏离中频0.5M的正弦波)如图:

     已尝试调整芯片端 006 寄存器 和 FPGA输入引脚时序约束;请问如何消除正弦波的毛刺?

新建位图图像.bmp

結果