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AD9106没有波形输出,检测到CLDO管脚异常

gongli1991@sina.cn 在 2016-10-21 詢問的問題
最後回覆由gongli1991@sina.cn於2016-10-26提供

已测过晶振输出时钟工作正常,vpp有近400mv;

 

对照datasheet检测芯片各管脚,发现CLDO引脚不是1.8v 直流电平,而是下图:

 

CLKVDD引脚我是外界3.3V给入,这里检测到CLDO异常,说明芯片内部的时钟稳压源并没有正常工作输出1.8V,换了芯片重测,一样的结果;

 

CLDO 引脚同时连接有100pf和0.1uf电容退耦。

 

发送的SPI时序对照手册来看,是正确的,就是找不出芯片4个通道均不出波形的原因,不知道是不是这个CLDO异常造成的。hpkamen

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結果